从 SoC → SoIC → CIC
从 SoC → SoIC → CIC，是芯片从 2D 平面集成 走向 3D 立体集成、再到 全空间立方集成 的技术演进路线，核心是突破摩尔定律极限，追求更高密度、更强性能、更低功耗。
1. SoC (System on Chip) —— 片上系统（2D 平面时代）
定义：
将 CPU、GPU、内存、接口、控制器 等所有功能模块，全部做在同一块硅片（Die） 上的单芯片系统。
特点：
• 平面集成：只有一层晶体管
• 同工艺制造：所有 IP 必须用同一代制程（如 5nm）
• 优点：延迟低、结构简单、成熟稳定
• 瓶颈：
◦ 工艺逼近物理极限，成本暴涨
◦ 不同模块（逻辑/存储/模拟）难以用同一工艺优化
◦ 面积、功耗、良率难以兼顾
2. SoIC (System on Integrated Chips) —— 集成片上系统（3D 堆叠时代）
定义：
台积电提出的 3D 先进封装技术，把多个 不同功能、不同工艺的小芯片（Chiplet） 用 无凸点（bumpless）混合键合 垂直堆叠。
核心优势：
• 异构集成：逻辑（7nm）+ 存储（12nm）+ 模拟（28nm）自由组合
• 无凸点键合：信号密度 ~14,000 个/mm²，接近片内水平
• 3D 堆叠：多层 Die 叠加，同体积下晶体管数翻倍
• 低延迟、低功耗：信号路径大幅缩短
两种形态：
• WoW (Wafer-on-Wafer)：整片晶圆对晶圆键合（精度高、效率高）
• CoW (Chip-on-Wafer)：已知好芯粒（KGD）贴到晶圆（良率更可控）
3. CIC (Cubic Integrated Circuit) —— 立方体集成电路（全 3D 立方时代）
定义：
更前沿的概念：真正三维空间化的芯片，不是简单“叠层”，而是在 X/Y/Z 三个方向 全立体布线、晶体管与互联网络均匀分布在整个“立方体”体积内。
核心理念：
• 从“平面板” → 真正的“芯片立方体”
• 互联更短、散热更优、密度更高
• 突破 2D 布线拥堵与散热墙
• 目前仍在 概念/研发阶段，是后摩尔时代的远期方向
如果CIC可以实现的话，如今全球最大的芯片，如餐盘大小的WSE二代晶体管的数量是2.6万亿，如果按照CIC的设计思路，完全可以在指尖大小的1立方厘米实现了。
三者对比:
• SoC：一块晶圆、一层功能、同工艺 → 2D 单芯片
• SoIC：多块小芯片、垂直堆叠、异工艺 → 3D 封装集成
• CIC：全三维立方、空间立体设计 → 终极 3D 芯片形态
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